Conception en VHDL

Code
US3109

Description

- Maîtriser un langage de description matériel

- Utiliser des outils de simulation

- Concevoir un design modulaire hiérarchique

- Evaluer l'impact de la conception sur la consommation et la puissance dissipée

- Optimiser le rapport surface / performance


Nombre d’ECTS
6
Durée en nombre d'heures
60.00
Type de notation
Notation chiffrée (sur 20)
Moyenne pour valider l'UE
10.00
Année de création
2017
Type d'unité
Unité spécifique
Déployabilité
Offre déployable dans le réseau en cas d'agrément
Examen national
Oui

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